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[家电产品] 功率辐射的问题

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楼主
发表于 2007-7-6 08:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
广东安规检测
有限公司提供:
对于晶振上的干扰,# Y3 |0 _4 R! x$ R! X: b5 ], R
7 A, E; {9 k1 F) q! R
在某一点上严重超标,是怎么解决的
( @$ v. M3 ]! G3 V6 f7 J5 b( P- i% |
0 w) {7 _$ [9 c% q3 ~9 p5 s6 ~$ n谢谢
沙发
发表于 2007-7-6 09:54 | 只看该作者
无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
板凳
 楼主| 发表于 2007-7-6 09:59 | 只看该作者
引用第2楼ds1983于2007-07-06 09:54发表的  :+ r8 q5 G* L4 o4 A
无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。

5 d+ ?' Q# k: O, `: o& `  P是的,好象没有接地的
# k1 F* p% h9 k6 a1 y) G
" `8 c/ M3 c; R是客户的板,没有仔细看的+ [( I! i2 \+ x3 [9 L9 N- \, t
8 H7 o( p9 f6 J$ _
是11.0592M这样的晶振# L, B) N% n: t2 H: ?! r
  N7 ?' |: L( U/ ~: W
只有这一点是有问题的& K8 \5 z# O' ]" f( J. |0 v  S& s  [! u

+ H/ X! I2 z9 x6 B头痛啊
地板
发表于 2007-7-7 00:47 | 只看该作者
我的一点点经验,你可试试6 j- E+ _; f5 B, j9 y/ r$ d+ r4 l
1。晶振外壳接地0 B+ \$ j3 X" u& h
2。在不影响性能的情况下关联电阻在两端,以降低其幅度
& K9 t- q1 M: Z1 D2 N3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致8 C2 H1 z' w! w/ U0 R" N
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
3 w) h2 h- X+ C) p8 E5。在电源线上加CORE
5#
 楼主| 发表于 2007-7-7 08:27 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :
+ ?9 H& S  R% P9 G. h4 I8 h( ]我的一点点经验,你可试试0 V$ [' `' c  B5 }5 w5 n, b
1。晶振外壳接地# R$ a, T2 |4 c( a5 p
2。在不影响性能的情况下关联电阻在两端,以降低其幅度) }& N( b5 O: z
3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致
4 ]; W- W+ F& c. w7 d7 W, k4。还不行就将整个晶振上方用铜片包住接地进行屏蔽2 t# d3 ^8 j# w) v8 Q. e' x
.......

2 s, l* l3 y% u2 I- s) q( T4 G+ C& e9 Z2 L8 I& X% g% B- W5 S
謝謝,
. H/ t1 c' c% ^
; m. B- O4 x2 Z" l並聯電阻,一般是多大的呢?: o% a( j. n; B1 S

$ b$ g1 L9 G9 d( l6 B1 x電源線有加的,信號線也有加,25*12*15的
6#
发表于 2007-7-8 10:05 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :: F  w- P$ E; v: \- Q& [$ N  R
我的一点点经验,你可试试2 w, ]1 r6 p5 {& X
1。晶振外壳接地
3 {  M5 z3 q4 H4 o6 ]* r- O! v2。在不影响性能的情况下关联电阻在两端,以降低其幅度" [$ G: a& V0 A; a/ n) h- R5 n
3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致
( z: e+ h( e' ^* P+ b  L4。还不行就将整个晶振上方用铜片包住接地进行屏蔽3 Q' r+ D. y7 E& m+ I; m( Z, |
.......
哈哈!mypcb兄回来了!欢迎欢迎!以后还请多指教!
7#
发表于 2007-7-8 14:53 | 只看该作者
晶振外壳接地,接地的铜皮要比晶振的体积大,并且最好在接近电源处引此地线。另外很可能是布线引起的,并非晶振。
8#
发表于 2007-7-9 17:34 | 只看该作者
引用第5楼bamboolight于2007-07-07 08:27发表的  :% ]* {: a1 }) J; j/ q9 X

8 f$ H% G8 s0 P3 }& L' _# D! N/ ?0 d7 R

  R. g5 s" N* O: Q謝謝,2 z9 \  R7 L; V) }7 u

# b* C$ Q0 F+ ~% ~7 D8 E, V, @.......

: A4 t7 W( w/ n3 N' J; K! y: @
- E! N8 K& B/ u% a/ j. m* B- X可先并一个1M的试试,看会不会有所改善
9#
发表于 2007-7-13 22:54 | 只看该作者
嗯,削减晶振的能量是一方面。另外,干扰是否可能由其他并排走的信号/控制线耦合而来?除了在电源线上加ferrite core,也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的,能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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